[01641126]一种新型数字电路与系统实验平台
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技术详细介绍
本实用新型公开了一种数字电路与系统实验平台，包括CPLD、FPGA/CPLD核心目标板、CPLD与FPGA/CPLD核心目标板连接，CPLD分别与MCU和分立元件自助实验区连接，CPLD输出端与第二显示模块输入端电连接，键盘输出端与CPLD的输入端连接，MCU与逻辑笔模块连接，MCU的输出端与第一显示模块输入端连接，FPGA/CPLD核心目标板与RAM电连接，FPGA/CPLD核心目标板的输入端与高速AD转换器的输出端电连接，FPGA/CPLD核心目标板输出端与高速DA转换器输入端电连接，能满足数字单元电路、小规模数字系统实验需要，还适合设计较大规模数字电子系统以及模拟与数字混合系统实验的需要。200720105545.4